数字时钟课程设计报告

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1、电子线路课程设计报告系 别： 机电与自动化学院 专业班级： 电气及自动化技术1001 学生姓名： 陈星涯 指导教师： 梁宗善 （课程设计时间：2012年 1月3日2012年 1月 13日） 华中科技大学武昌分校目 录1. 课程设计目的 3页2. 课程设计题目描述和要求 3页2.1 课程设计题目3页2.2 课程设计要求3页3. 比较和选定设计的系统方案4页3.1 数字钟的构成4页4. 单元电路设计及工作原理5页4.1 时基电路5页 a.多谐振荡器的工作原理5页4.2 计数器7页 a.中规模计数器组件介绍7页 b.60进制计数器8页 c.12翻1计数器9页4.3 译码器10页4.4 显示器10页4

2、.5校时电路11页4.6定时控制电路12页4.7仿广播电台正点报时电路13页5. 调试过程及分析14页 5.1 显示器故障排查14页 5.2 计数器调试及分析15页 5.3 校时电路的调试16页 5.4 增加抗干扰电路16页 5.5 闹时电路的调试17页 5.6 仿广播电台整点报时电路调试17页6. 课程设计总结17页7. 参考文献19页8. 附件一：电子时钟主体电路电路图20页9. 附件二：扩展电路电路图21页10. 附件三：系统所需元器件清单22页11. 课程设计成绩23页一、设计任务与目的数字时钟是一种利用数字电路技术实现时、分、秒计时的装置，与传统的机械式时钟相比，它具有更高的准确性和

3、直观性，性能稳定，使用寿命长，且无机械传动装置。此外，它还具有整点报时、定时响闹功能，因此在人们日常的生活、学习、工作中有广泛的使用，已经成为了一种不可缺少的必需品。 数字时钟从原理上讲是一种典型的数字电路，其中包括了组合逻辑电路和时序逻辑电路。因此，我们此次设计与制作的目的是了解数字时钟的原理，从而学会制作数字钟。通过数字时钟的制作，进一步了解在电子产品制作中用到的中小规模集成电路的作用及实用方法，学习与掌握各种组合逻辑电路与时序逻辑电路的原理与使用方法。二、课程设计题目描述和要求1、课程设计题目设计一个有“时”、“分”、“秒”显示，且有校时功能的数字电子钟。2、课程设计要求 a.振荡器电路

4、设计；b.分频器电路设计；c.时、分、秒计数器的设计；d.时、分、秒译码显示电路的设计；e.60进制电路，24进制电路（或12翻1电路）设计；f.校时电路设计；g.定时控制电路的设计；h.仿电台整点报时电路的设计。三、比较和选定设计的系统方案数字钟的构成 数字时钟实际上是一个对标准频率（1HZ）进行计数的计数电路，由于计数的起始时间不可能与标准时间（如北京时间）一致，故需要在电路上加一个校时电路，同时标准的1kHz时间信号必须做到准确稳定。通常使用石英晶体振荡器电路构成数字钟。 数字钟组成方框图 图由图可见：本数字钟电路主要由震荡器、分频器、校时电路、时分秒计数器、译码显示器及整点报时电路、定

5、时控制电路构成。它们的工作原理是：由震荡器产生的高频脉冲信号作为数字钟的时间基准，再经过分频器输出标准“秒脉冲”送入秒计数器，秒计数器采用60进制计数器，每累计60秒发出一个“分脉冲”信号，该信号作为分计数器的脉冲信号，分计数器也采用60进制计数器，每累计60分钟发出一个“时脉冲”信号，该信号将被送到时计数器，时计数器采用12翻1计数器。译码显示电路将时、分、秒计数器的输出状态送到七段译码显示器，通过六位LED七段显示器显示出来。校时电路用来对时、分显示数字进行调整；整点报时电路则根据计时系统的输出状态产生一脉冲信号，然后去触发音频发生器实现报时；定时控制电路由指定时刻发出的信号，驱动音响电路

6、。 四、单元电路设计及工作原理1.时基电路时基电路的作用是产生一个标准时间信号（高电平持续时间为1s）。本次课程设计时基信号由555定时器组成的多谐振荡器和3片74LS90构成的分频器产生，如图附件二时基电路电路图。a.多谐振荡器的工作原理 多谐振荡器是能产生矩形波的一种自激振荡器电路，由于矩形波中除基波外还含有丰富的高次谐波，故称为多谐振荡器。由555定时器构成的多谐振荡器如图1所示，R1，R2和C是外接定时元件，电路中将高电平触发端（6脚） 和低电平触发端（2脚）并接后接到R2和C的连接处，将放电端（7脚）接到R1，R2的连接处。由于接通电源瞬间，电容C来不及充电，电容器两端电压uc为低电

7、平，小于（1/3）Vcc，故高电平触发端与低电平触发端均为低电平，输出uo为高电平，放电管VT截止。这时，电源经R1，R2对电容C充电，使电压uc按指数规律上升，当uc上升到（2/3）Vcc时，输出uo为低电平，放电管VT导通，把uc从（1/3）Vcc 上升到（2/3）Vcc这段时间内电路的状态称为第一暂稳态，其维持时间TPH的长短与电容的充电时间有关 。充电时间常数T充=（R1R2）C。由于放电管VT导通，电容C通过电阻R2和放电管放电，电路进人第二暂稳态.其维持时间TPL的长短与电 容的放电时间有关，放电时间常数T放R2C0随着C的放电，uc下降，当uc下降到（1/3）Vcc时，输出uo。

8、 为高电平，放电管VT截止，Vcc再次对电容c充电，电路又翻转到第一暂稳态。不难理解，接通电源后，电 路就在两个暂稳态之间来回翻转，则输出可得矩形波。电路一旦起振后，uc电压总是在（1/32/3）Vcc 之间变化。图1（b）所示为工作波形。2计数器秒脉冲信号经过6级计数器，分别得到“秒”个位、“秒”十位、 “分”个位、“分”十位以及“时”个位、“时”十位的计时。“秒”、“分”、计数器为60进制，小时为24进制。a.中规模计数器组件介绍 二-五-十进制计数器74LS90内部具有两个独立的计数器：一个是模二计数器；另一个为模五计数器；它的功能除计数外，还可以直接置零和直接置9，74LS90功能表见

9、表。74LS90计数时序见表。 74LS90功能表：R0（1）R0（2）R9（1）R9（2）Qd Qc Qb QaHHLXL L L LHHXLL L L LXXHHH L L HXLXL 计数LXLX 计数LXXL 计数XLLX 计数表174LS90计数时序：计数二-十进制二-五混合进制输 出输 出QdQcQbQaQaQdQcQb000000000100010001200100010300110011401000100501011000601101001701111010810001011910011100表2b.60进制计数 “秒”计数器电路与“分”计数器电都是60进制，它由一级10进制计

10、数器和一级6进制计数器连接构成，如图2所示，采用两片中规模集成电路74SL90串接起来构成的“秒”、“分”计数器。图2IC1是十进制计数器，QD1作为十进制的进位信号，74LS90计数器是十进制异步计数器，用反馈归零方法实现十进制计数，IC2和与非门组成六进制计数。74LS90是在CP信号的下降沿翻转计数，QA2和QC2相与0101的下降沿，作为“分”(“时”)计数器的输入信号。QB2和QC20110高电平1分别送到计数器。清零R01和R02，74LS90内部的R01和R02与非后清零而使数器归零，完成六进制计数。由此可见IC1和IC2串联实现了进制。C.12翻1计数器 小时计数电路是由74L

11、S74和74LS191组成的12翻1计数，如图3所示。 当数字时钟运行到12时59分59秒时，秒的个位计数器再输入一个秒脉冲的时数字时钟应自动显示为01时00分00秒。 图33译码器 译码是将给定的代码进行翻译。计数器采用的码制不同，译码电路也不同。 CC4511驱动器是与8421BCD编码计数器配合用的七段译码驱动器。CC4511配有灯测试LT、动态灭灯输入RBI、灭灯输入/动态灭灯输出BI/RBO，当LT=“0”时，CC4511输出全“1”。CC4511的使用方法参照该器件功能的介绍。CC4511的输出端和计数器对应的输出端、CC4511的输出端和七段显示器的对应段相连。4显示器 当数字钟

12、的计数器CP脉冲的作用下，按60秒为一分、60分为一个小时，24小时为一天的计数规律计数时，就应将其状态显示成清晰的数字符号。这就需要将计数器的状态进行译码并将其显示出来。本设计采用现在广泛使用的七段字符显示器来输出的数字，这种字符显示器由七段可发光的线段拼合而成，显示器有两种：共阳极或共阴极显示器。共阳极数码管的七个发光二极管的阳极接在一起，而七个阴极则是独立的。共阴极数码管与共阳极数码管相反，七个发光二极管的阴极接在一起，而阳极是独立的。当共阳极数码管的某一阴极接低电平时，相应的二极管发光，可根据字形使某几段二极管发光，所以共阳极数码管需要输出低电平有效的译码器去驱动。共阴极数码管则需输出

13、高电平有效的译码器去驱动。CC4511译码器对应的显示器是共阴（接地）显示器。5.校时电路校时电路实现对“时”、“分”、“秒”的校准。在电路中设有正常计时和校时位置。“秒”、“分”、“时”的校准开关分别通过RS触发器控制。 如图4到时个位计数器 到分个位计数器 图46.定时控制电路设计 设计要求上午7时39分发出闹时信号，持续时间为一分钟。 因为7时39分对应的数字钟的时个位计数器的状态（Q3Q2Q1Q0）H1=0111，分十位计数器的状态为(Q3Q2Q1Q0)M2=0011，分个位计数器的状态为（Q3Q2Q1Q0）M2=1001。若将上述计数器输出为“1”的所有输出端经过与门电路去控制音响电

14、路，可以使音响电路正好在7点39分响，持续一分钟后停响。所以闹时控制电路信号Z的表达式为Z=（Q2Q1Q0）H1（Q1Q2）M2（Q3Q0）M1M 式中M=1用与非门实现上式所表达的逻辑功能，则可以将Z进行布尔代数变换，即实现上式的逻辑电路图如图5所示，其中74LS74为四输入二与非门，74LS03为集电极开路的2输入四与非门，因OC门的输出端可以线与，使用时在它们的输出端与电源之间应该接一电阻R，外接电阻R的最大值当OC门输出为低电平时，外界电阻R最小值这里R3.3k。图由图5可见上午7点39分时，音响电路的晶体管导通，则扬声器发出1kHz的声音。持续一分钟后晶体管因输入端为“0”而截止，电

15、路闹停。7.仿广播电台正点报时电路仿广播电台正点报时电路的功能要求是：每当数字钟计时快要到正点时发出声响，通常按照4低音1高音的顺序发出间断声响，以最后一声高音结束的时刻为正点时刻。设4声低音(约500Hz)分别发生在59分51秒、53秒、55秒及57秒，最后一声高音(约1kHz)发生在59分59秒，它们的持续时间均为1秒。如表3所示。 由表3可得：Q3S1 =“0” 时500Hz输入音响； Q3S1 =“1” 1kHz输入音响。只有当分十位的Q2M2Q0M211，分个位的Q3M1、Q0M111。秒十位的Q2s2Qos211及秒个位的Q0S11时，音响电路才能工作。仿电台正点报时的电路如图6所

16、示。 表3 图65、 调试过程及分析1. 显示器故障排查及分析 搭建好电子时钟的主体电路后，使用函数信号发生器输出频率为1Hz，幅值为5V的方波信号连接到电子时钟秒计数器74LS90的CPA端，发现显示器显示出来的是乱码，后将+5电源分别加在CC4511与显示器abcdefg脚相连的9到15脚，发现其中一个显示器有一段不亮，于是推测该段坏掉了或者该段现对应的阳极线路接触不好，后将连接该脚的电线拔掉换了一根线，再检测，显示正常，但是乱码依然存在，仔细的检查CC4511的9到15脚分别通电后显示器各个段发亮的对应位置，发现g脚与f脚接反了，将接线改好后，显示器正常。在后来的调试过程中发现多个显示器

17、出现个别显示段不亮，使用同样的方法检测发现显示器是烧坏，经老师指导原来是我们的电路没有给显示器串联限流电阻，导致显示器电流过大极易损坏，于是给显示器串联一个51欧姆的电阻，问题得到解决。2. 计数器调试及分析在给秒位计数器的CPA端输入频率为1Hz，幅值为5V的方波信号后，显示器并没有进位也没有随着脉冲信号跳动，分析是74LS90出了故障，更换一个74LS90后问题依然存在，于是仔细对照电路图检查线路，发现74LS90的置零端没有接地， 将74LS90的置零端接地后秒个位显示器正常计数，但是秒十位的计数出现紊乱。首先为了判断是74LS90的进位脉冲是否正常，将74LS90的11脚连线拔出，连接

18、到示波器观察、测量，经计算发现11脚输出波形正常，接着将函数信号发生器产生的信号连接到74LS92的CPA端，发现秒时位的显示器计数依然紊乱，继续检查74LS92与CC4511之间的接线，发现Q2脚与Q0脚接错，将接线改正后给74LS92的CPA端接入信号，秒十位的显示器正常计数，将秒个位74LS90的11脚与秒十位的74LS92连接好，给秒个位接入1Hz方波信号，秒十位进位正常，到此为止秒的60位进制计数器以及显示器调试完成工作正常。使用同样的方法调试分的60位进制计数器和时的12翻1计数器以及相应的译码器，全部调试完成，可以正常工作。3. 校时电路的调试主电路的所有计数器以及译码器调试完成

19、后，将校时电路接入，给电路输入100Hz方波信号后秒显示计数正常，但是分的个位没有进位，将秒十位的进位脉冲直接连接到分个位74LS92的CPA端，通入信号后分的进位正常，但是时的个位不进位，同样将分十位的进位脉冲直接连接到74LS191的CPA端，时的个位开始进位，依次判断，是校时电路出了故障。后检查三个74LS00集成2输入四与非门的接线，没有发现错误，于是怀疑是元件损坏，更换74LS00后发现问题依然存在，后进一步检查整体电路恍然发现74LS00的地线没有接入主线路的地线，连接地线后秒、分、时进位终于都正常了。4. 增加抗干扰电路为了验证时钟的稳定性和提高效率，使用函数信号发生器输出频率为

20、1KHz的方波接入到秒个位计数器74LS92的CPA端，使时钟开始工作，观察各个计数器的工作情况。发现时十位在“翻1”的时候很不稳定，有时候“翻1”有时候甚至“乱跳”，在老师的指导下给电源并联一个大电容和一个小电容，组成抗干扰电路，并且将D触发器即74LS74的1端接高电平，再次试验，每次12点过后都顺利“翻1”了，也不会“乱跳”，电路抗干扰能力明显加强。5. 闹时电路调试主体电路调试完毕后搭建闹时电路与主体电路连接并接通电源。设定在7点39分报时一分钟，结果实验时每个小时段的39分都会报时，分析逻辑表达式和电路后初步判断问题出在报时电路时个位与主体电路的连接处，将主体电路时间调到7点39分后

21、除去主体电路进位脉冲，使时钟停留在7点39分，用示波器分别检测报时电路4输入二与非门各处电平，发现与表达式（Q2Q1Q0）H1=111、M=1一致。于是将主体电路的时间跳到10点39分，继续检查上述与非门各脚电平（Q2Q1Q0）H1=010、M=1与预期一致，继续检测与非门输出脚，为高电平，与预期一致，再检测OC门的输出脚，为高电平与预期相反，于是判断判断OC门74LS03损坏，更换后再次检测，与预期一致。调节主体电路，使其在7点30分开始工作，到7点39分时准确报时持续一分钟，使时钟工作到其他时间段，在39分时均未报时。6. 仿广播电台正点报时电路调试 依照电路图搭建好仿广播电台正点报时电路

22、并接入主体电路，通电后电子时钟开始工作，经观察，在准点前十秒开始每隔一秒发出低鸣声，准点后结束。与预期结果一致。 6、 课程设计总结经过二周课时的构思、设计，我的数电课程设计数字时钟最终得以圆满结束。通过紧张而充实的课程设计，我不仅提高了动手操作能力，还对我以后所要做的毕业设计有了初步的了解。做好一个课程设计或毕业设计不仅要具备扎实的书本知识并会善于应用，还要学会利用网络资源查阅资料。最重要的是让我感受团队合作的优势和重要性，我这个人比较性急，有些毛手毛脚，老把线路接错却怎么也找不出来，结果没有了耐心，都想放弃了，还好跟我的同组的陈力同学非常细心，每次由我接线，他帮我检查，几乎总能帮我精准的检

23、查出错误，为我们节省了很多时间，也提高了我的积极性和信心。另外，通过这次课程设计，暴露出了我的很多性格上的缺点，缺乏耐心，容易粗心，同时让我体会到了实际的工作与书本上的知识是有一定距离的，我们还需要进一步的学习。从客观上对自己在书本中所学的知识有了感性的认识，使自己更加充分地理解了理论与实际的关系，在这次课程设计中，我学会了如何看电路图,读电路图, 如何利用网络资源, 并对数字电路的应用和开发的设计思想有了更进一步的了解和掌握，使自己的知识体系更加健全，加深了对数字电子技术的了解。从这次设计中，我体会到，如果将我们在大学里所学的知识与更多的实践结合在一起，用实践来检验真理，使一个大学生具备较强

24、的处理基本事务的能力与比较系统的专业知识，进一步锻炼自身的动手能力，为将来能在社会上立足打下坚实的基础。 7、 参考资料1梁宗善电子技术基础课程设计华中科技大学出版社，20092朱定华电子电路测试与实验清华大学出版社，20043朱定华模拟电子技术基础清华大学出版社 北京交通大学出版社，20054朱定华现代数字电路与逻辑设计清华大学出版社 北京交通大学出版社，20075华成英，童诗白模拟电子技术基础（第四版）高等教育出版社，20066阎 石数字电子技术基础（第五版）高等教育出版社，20067康华光电子技术基础（第五版）模拟部分高等教育出版社，20068康华光电子技术基础（第五版）数字部分高等教育

25、出版社，20069陈大钦，罗 杰电子技术基础实验（第三版）高等教育出版社，200810罗 杰，谢自美电子线路设计实验测试（第四版）电子工业出版社，200811毕满清电子技术实验与课程设计（第三版）机械工业出版社，2005 课程设计成绩:项 目业务考核成绩（70%）（百分制记分）平时成绩（30%）（百分制记分）综合总成绩（百分制记分）数字电子时钟注:教师按学生实际成绩（平时成绩和业务考核成绩）登记并录入教务MIS系统，由系统自动转化为“优秀（90100分）、良好（8089分）、中等（7079分）、及格（6069分）和不及格（60分以下）”五等。指导教师评语:指导教师（签名）: 20 年 月 日21