集成电路设计工艺流程

《集成电路设计工艺流程》由会员分享，可在线阅读，更多相关《集成电路设计工艺流程（8页珍藏版）》请在装配图网上搜索。

1、集成电路设计工艺流程晶体的生长晶体切片成 wafer晶圆制作功能设计a模块设计a电路设计a版图设计a制作光罩工艺流程(1) 表面清洗晶圆表面附着一层大约2um的AI2O3和甘油混合液保护之,在制作前必须进行化学刻蚀和表面清洗。文档来自于网络搜索(2) 初次氧化有热氧化法生成 SiO2缓冲层，用来减小后续中Si3N4对晶圆的应力。氧化技术干法氧化Si(固)+ O2 a SiO2(固)湿法氧化Si(固)+2H2O a SiO2(固)+ 2H2干法氧化通常用来形成，栅极二氧化硅膜，要求薄，界面能级和固定电荷密度低的薄膜。干法氧化成膜速度慢于湿法。湿法氧化通常用来形成作为器件隔离用的比较厚的二氧化硅膜

2、。当SiO2膜较薄时，膜厚与时间成正比。SiO2膜变厚时，膜厚与时间的平方根成正比。因而，要形成较厚的SiO2膜，需要较长的氧化时间。SiO2膜形成的速度取决于经扩散穿过SiO2膜到达硅表面的 O2及OH基等氧化剂的数量的多少。湿法氧化时，因在于 OH基在SiO2膜中的扩散系数比 O2的大。氧化反应，Si表面向深层移动，距离为SiO2膜厚的0.44倍。因此，不同厚度的 SiO2膜，去除后的Si表面的深度也不同。 SiO2 膜为透明，通过光干涉来估计膜的厚度。这种干涉色的周期约为200nm，如果预告知道是几次干涉，就能正确估计。对其他的透明薄膜，如知道其折射率，也可用公式计算出文档来自于网络搜索

3、(d SiO2) / (d ox) = (n ox) / (n SiO2) 。 SiO2膜很薄时，看不到干涉色，但可利用Si的疏水性和SiO2的亲水性来判断 SiO2膜是否存在。也可用干涉膜计或椭圆仪等测出。 文档来自于 网络搜索SiO2和Si界面能级密度和固定电荷密度可由MOS二极管的电容特性求得。 (100)面的Si的界面能级密度最低， 约为10E+10 -10E+11/cm- 2 .e V -1 数量级。(100)面时，氧化膜中固定电荷较多，固定电荷密度的大小成为左右阈值的主要因素。文档来自于网络搜索(3) CVD(Chemical Vapor deposition) 法沉积一层 Si3

4、N4(Hot CVD 或 LPCVD)。文档来自于网络搜索1 常压 CVD (Normal Pressure CVD)NPCVD为最简单的 CVD法，使用于各种领域中。其一般装置是由(1)输送反应气体至反应炉的载气体精密装置；(2)使反应气体原料气化的反应气体气化室； (3)反应炉；(4) 反应后的气体回收装置等所构成。其中中心部分为反应炉，炉的形式可分为四个种类， 这些装置中重点为如何将反应气体均匀送入，故需在反应气体的流动与基板位置上用心改 进。当为水平时，则基板倾斜；当为纵型时，着反应气体由中心吹出，且使基板夹具回转。 而汽缸型亦可同时收容多数基板且使夹具旋转。为扩散炉型时，在基板的上游

5、加有混和气体使成乱流的装置。 文档来自于网络搜索2 低压 CVD (Low Pressure CVD)此方法是以常压 CVD 为基本，欲改善膜厚与相对阻抗值及生产所创出的方法。主 要特征：(1)由于反应室内压力减少至10-1000Pa而反应气体，载气体的平均自由行程及扩散常数变大，因此，基板上的膜厚及相对阻抗分布可大为改善。反应气体的消耗亦可减少；（2）反应室成扩散炉型，温度控制最为简便，且装置亦被简化，结果可大幅度改善其可靠性 与处理能力（因低气压下，基板容易均匀加热），因基可大量装荷而改善其生产性。文档来自于网络搜索3 热 CVD （Hot CVD）/（thermal CVD）此方法生产性

6、高，梯状敷层性佳（不管多凹凸不平，深孔中的表面亦产生反应，及气体可到达表面而附着薄膜）等，故用途极广。膜生成原理，例如由挥发性金属卤化物（MX）及金属有机化合物（MR）等在高温中气相化学反应（热分解，氢还原、氧化、替换反应等）在基板上形成氮化物、氧化物、碳化物、硅化物、硼化物、高熔点金属、金属、半导体等薄 膜方法。因只在高温下反应故用途被限制，但由于其可用领域中，则可得致密高纯度物质膜， 且附着强度极强，若用心控制，则可得安定薄膜即可轻易制得触须（短纤维）等，故其应用范围极广。热 CVD法也可分成常压和低压。低压CVD适用于同时进行多片基片的处理，压力一般控制在之间。作为栅电极的多晶硅通常利用

7、HCVD法将SiH4或Si2H。气体热分解（约 650 oC ）淀积而成。采用选择氧化进行器件隔离时所使用的氮 化硅薄膜也是用低压CVD法，利用氨和 SiH4 或Si2H6反应面生成的，作为层间绝缘的SiO2薄膜是用 SiH4和02在400 -4500 oC的温度下形成文档来自于网络搜索SiH4 + O2 -SiO2 + 2H2或是用 Si（OC2H5）4 （TEOS: tetra - ethoxy - silanc ）和 O2 在 750 oC 左右的高温 下反应生成的，后者即采用TEOS形成的SiO2膜具有台阶侧面部被覆性能好的优点。前者，在淀积的同时导入 PH3 气体，就形成磷硅玻璃（P

8、SG : phosphor - silicate-glass ）再导入 B2H6 气体就形成 BPSG（borro - phosphor - silicate - glass） 膜。这两种薄膜材料，高温下的流动性好，广泛用来作为表面平坦性好的层间绝缘膜。文档来自于网络搜索4 电浆增强 CVD （Plasma En ha need CVD）NPCVD 法及LPCVD 法等皆是被加热或高温的表面上产生化学反应而形成薄膜。PECVD是在常压 CVD或LPCVD的反应空间中导入电浆（等离子体），而使存在于空间中的气体被活化而可以在更低的温度下制成薄膜。激发活性物及由电浆中低速电子与气体撞击而产生。 文

9、档来自于网络搜索光 CVD （Photo CVD）PECVD 使薄膜低温化，且又产生如 A-Si般的半导体元件。但由于薄膜制作中需考虑：（1）在除去高温（HCVD）及PECVD时掺入元件中的各种缺陷（女口 PECVD中带电粒子撞击而造成的损伤）；（2）不易制作的元件 （不纯物剖面），不希望在后面受到工程高温处 理被破坏，因此希望可于低温中被覆薄膜。PCVD是解决这此问题的方法之一。遇热分解时，因加热使一般分子的并进运动与内部自由度被激发（激发了分解时不需要的自由度），相对的，在 PCVD 中，只直接激发分解必须的内部自由度，并提供活化物促使分 解反应。故可望在低温下制成几无损伤的薄膜且因光的聚

10、焦及扫描可直接描绘细线或蚀刻。文档来自于网络搜索5 MOCVD （Metal Organic CVD） & 分子磊晶成长 （Molecular Beam Epitaxy）文档来自于网络搜 索CVD 技术另一重要的应用为MOCVD ，此技术与 MBE（Molecular Beam Epitaxy）同为：（1）成长极薄的结晶；（2）做多层构造；（3）多元混晶的组成控制；（4）目标为化合物半导体的量产。此有装置有下列特征：（1）只需有一处加热，装置构造简单，量产装置容易设计；（2）膜成长速度因气体流量而定，容易控制；（3）成长结晶特性可由阀的开头与流量控制而定；（4）氧化铝等绝缘物上可有磊晶成长；（

11、5）磊晶成长可有选择，不会被刻蚀。相反地亦有：（1）残留不纯物虽已改善，但其残留程度极高；（2）更希望再进一步改良对结晶厚度的控制；（3）所用反应气体中具有引火性、发水性，且毒性强的气体极多；（4）原料价格昂贵等缺点。文档来自于网络搜索 多层布线间的层间绝缘膜的沉积，以及最后一道工序的芯片保护膜的沉积必须在低温下 （450 C 以下）下进行，以免损伤铝布线。等离子 CVD 法就是为此而发明的一种方法。 文档来自于网络搜索6外延生长法 （LPE）外延生长法（epitaxial growth）能生长出和单晶衬底的原子排列同样的单晶薄膜。在双 极型集成电路中，为了将衬底和器件区域隔离（电绝缘），在P

12、型衬底上外延生长 N型单晶硅层。在 MOS集成电路中也广泛使用外延生长法，以便容易地控制器件的尺寸，达 到器件的精细化。此时，用外延生长法外延一层杂质浓度低（约10 15 cm-3）的供形成的单晶层、衬底则为高浓度的基片，以降低电阻，达到基极电位稳定的目的。LPE可以在平面或非平面衬底生长、能获得十分完善的结构。LPE可以进行掺杂，形成n-和p-型层，设备为通用外延生长设备，生长温度为300 oC-900 oC，生长速率为 0.2um-2um/min ，厚度0.5um-100um，外延层的外貌决定于结晶条件，并直接获得具有绒面结构表面外延层。文档来自于网络搜索（4）涂敷光刻胶 光刻制造过程中，

13、往往需采用20-30道光刻工序，现在技术主要采有紫外线（包括远紫外线）为光源的光刻技术。光刻工序包括翻版图形掩膜制造，硅基片表面光刻胶的涂敷、预 烘、曝光、显影、后烘、腐蚀、以及光刻胶去除等工序。文档来自于网络搜索（1）光刻胶的涂敷在涂敷光刻胶之前，将洗净的基片表面涂上附着性增强剂或将基片放在惰性气体中进 行热处理。这样处理是为了增加光刻胶与基片间的粘附能力，防止显影时光刻胶图形的脱落以及防止湿法腐蚀时产生侧面腐蚀（side etching）。光刻胶的涂敷是用转速和旋转时间可自由设定的甩胶机来进行的。首先、用真空吸引法将基片吸在甩胶机的吸盘上，将具有一定粘度的光刻胶滴在基片的表面，然后以设定的

14、转速和时间甩胶。由于离心力的作用，光刻胶在基片表面均匀地展开，多余的光刻胶被甩掉，获得一定厚度的光刻胶膜，光刻胶的膜厚是由光刻胶的粘度和甩胶的转速来控制。所谓光刻胶，是对光、电子束或X线等敏感，具有在显影液中溶解性的性质，同时具有耐腐蚀性的材料。一般说来，正型胶的分辩率高，而负型胶具有高感光度以及和下层的粘接性能好等特点。光刻工艺精细图形 （分辩率，清晰度），以及与其他层的图形有多高的位置吻合精度（套刻精度）来决定，因此有良好的光刻胶，还要有好的曝光系统。文档来自于网络搜索（2）预烘（pre bake）因为涂敷好的光刻胶中含有溶剂，所以要在80C左右的烘箱中在惰性气体环境下预烘15-30分钟，

15、去除光刻胶中的溶剂。文档来自于网络搜索（3）曝光将高压水银灯的 g线（1=436 nm）, i线（l=365nm）通过掩模照射在光刻胶上，使光刻 胶获得与掩模图形同样的感光图形。根据曝光时掩模的光刻胶的位置关系，可分为接触式曝光、接近式曝光和投影曝光三种。而投影曝光又可分为等倍曝光和缩小曝光。缩小曝光的分辩率最高，适宜用作加工，而且对掩模无损伤，是较常用的技术。缩小曝光将掩模图形缩小为原图形的1/5-1/10，这种场合的掩模被称为掩模原版（reticle）。使用透镜的曝光装置，其投影光学系统的清晰度R和焦深D分别用下式表示：文档来自于网络搜索R=k1 入 /NAD=k2 入 /（NA） 2入曝

16、光波长NA 透镜的数值孔径k1、 k2 为与工艺相关的参数，k1(0.6-0.8), k2(0.5)由此可知：要提高清晰度(R变小)，必须缩短波长，加大透镜数值孔径。随着曝光波长的缩短，清晰度得到改善，但是焦深却变短，对光刻胶表面平坦度提出了更严格的要 求，这是一个很大的缺点。通常采用的高压水银灯，还有比高压水银灯l-line波长短的远紫外线准分子激光器(excimer laser, KrF:248nm,ArF:193 nm) 为曝光光源。为了解决上述所提到的缺点，用比光的波长更短的X线(1=1-10nm)作为曝光光源，技术上有很大的进展，利用X线和电子束进行光刻时，其焦深较深，对表面平坦度没

17、有苛刻的要求。文档来自于网络搜索接近式曝光技术为光罩掩模与基板相互靠近保持较近的间隙(gap)，以UV光由MASK侧面照射，将图案投射在基板上对光阻进行曝光。一般而言，光罩尺寸较基板大， 所以图案将以1:1的大小转印到光阻上，此方法精度较所常用的步进机(stepper,能输出一定频率和波长的光线)或镜像投影(Mirror Projectio n)来得差，但其优点为产量 (throughput)大，设备便宜。在光学系统中，大型的准直镜 (collimate mirror)(球面或非球 面)对转刻精度影响最大，以日前制作水准而言，倾斜角(declination angle)约可以做到 + -0.3

18、以内。若倾斜角过大，则基片边缘的图案将与光罩设计的位置有所差别，将影响到totalpitch(图案实际长度与设计长度的误差容忍值)的误差。而一般接近式曝光技术解析度与光罩及基板的间隙和光的波长有关。随着基片的增大，光罩也随之增大，由于光罩本身的重量会使得光罩中间部分向下弯曲。如果弯曲程度得到控制，利用光线反射原理的检测(类似光的薄膜干涉)来推算光罩与基板的距离。光罩精密对位技术，此对位技术可分为两部 分，一部分利用 CCD (charge coupled device)将光罩上及基板上的记号重叠后做图像分析处 理，即可知目前的对位情形，再配合另一部分可精确移动的对准台(alignment st

19、age)，控制其X,Y方向及角度的位移。温度的管理，因光罩与基板两者膨胀系数不同，同一特定温度 下，光照的影响将会造成误差。光罩的温度控制方法是利用经过温控后的洁净空气吹向光罩表面使光罩全面的温度分布均匀，而对基板是利用温控后的水流承载基板的基台来控制。文档来自于网络搜索就曝光系统而言，所使用的UV光源为10kw的超高水银灯，经过椭圆镜，多层镀膜反射镜等光学系统后投射在光罩及光刻胶上，为了使投射光有良好的均一性及平行度以增加曝光精度，在光学系统中通常会使用Fly eye lens及大型的球面镜。以超高水银灯所发出的UV 而言主，强度有三个峰值分别为g-line(436nm),h-line(40

20、6nm),i-line(365nm),其中正型光阻对 g-line及h-line较敏感，i-line通常对负胶有较好的曝光效率。由于为了不使 UV光的强度下降，光学系统中所使用的镜光学为合成的石英所制，多层镀膜的镜片也被设计成增加 UV区的反射率。文档来自于网络搜索(4) 显影将显影液全面地喷在光刻胶上，或将曝光后的样片浸在显影液中几十秒钟，则正型 光刻胶的曝光部分(或负胶的未曝光部分)被溶解。显影后的图形精度受显影液的浓度，温度以及显影的时间等影响。显影后用纯水清洗。文档来自于网络搜索(5) 后烘(post bake)为使残留在光刻胶中的有机物溶液完全挥发，提高光刻胶和基片的粘接性及光刻胶的

21、耐腐蚀能力，通常将基片在120- 200 oC温度下烘干 20-30分钟。文档来自于网络搜索腐蚀 (etching) 经过上述工序后，以复制到光刻胶上的集成电路的图形作为掩模，对下层的材料进行腐蚀。腐蚀技术是利用化学腐蚀法把材料的某一部分去除的技术。腐蚀技术分为两大类：湿法腐蚀进行腐蚀的化学物质是溶液；干法腐蚀（一般称刻蚀）一进行的化学物质是气体。文档来自于网络搜索1湿法腐蚀，采用溶液进行的腐蚀是一种各向同性腐蚀。因而，光刻胶掩模下面的薄膜材料，在模方向上也随着时间的增长而受到腐蚀，因此，出现与掩模图形不一致的现象，不适用于精细化工艺。但湿法腐蚀具有设备便宜，被腐蚀速度与光刻胶的腐蚀速度之比（

22、选择比）大，对腐蚀表面无污染，无损伤等优点，适用于非精细化图形的加工。典型的SiO2膜的腐蚀为稀释的 HF溶液或HF、氟化氨混合液 （也称缓冲氢氟酸液），氮化硅膜的腐蚀液为180 oC左右的热磷酸；铝的腐蚀液为磷酸溶液（磷酸：醋酸：硝酸 =250 : 20 :3,55 + - 5 oC。文档来自于网络搜索2干法腐蚀干法刻蚀分为各向同性刻蚀和各向异性刻蚀两种，采用等离子进行刻蚀是各向同性的典型。在光刻胶去胶装置中，氧的等离子体和光刻胶反应形成H20和CO2气体。此时，作为反应基的氧原子团与光刻胶进行各向同性反应。精细图形进行各向异性很强的干法刻蚀来实现。反应性离子刻蚀（RIE:reactive

23、ion etching）是一种典型的例子。RIE是利用离子诱导化学反应，同时离子还起着去除表面生成物露出清洁的刻蚀表面的作用。但是，这种刻蚀法不能获得高的选择比， 刻蚀表面的损伤大， 有污染，难以形成更精细的图形。作为替代技术是能量低，高真空状态下也具有高密度的电子回旋共振等离子设备的开发。对于栅电极材料的多晶硅（polysilicon）来说，它的刻蚀条件必须具备相对于下层10nm左右的栅极 SiO2膜层有高的选择比。而SiO2的刻蚀条件又必须相对于单晶硅和多晶硅都有高的选择比。作为布线材料的铝合金， 表面有牢固的三氧化二铝薄膜，必须先以强濺射条件将其去除后再开始刻蚀，在铝刻蚀以后，要去除表面

24、残留在铝薄膜上的氯化物，以免刻蚀铝布线。文档来自于网络搜索3 同步辐射 （SOR : synchrotron orbital radiation）X 线光刻技术 文档来自于网络搜索SOR是在电子沿着加速器的圆形储存环以光的速度前进时，其前进的轨道因磁场而弯曲， 在轨道切线方向上放射出的光，同步加速辐射光源是一个指向性好，强度大的理想的X线源。文档来自于网络搜索光刻胶的去除经腐蚀完成图形复制以后，再用剥离液去除光刻胶，完成整个光刻工序。可以用无机溶 液如硫酸或干式臭氧烧除法将光阻去除。文档来自于网络搜索（5）此处用干法氧化法将氮化硅去除（6） 离子布植将硼离子（B+3） 透过SiO2膜注入衬底，

25、形成P型阱1离子注入法是利用电场加速杂质离子，将其注入硅衬底中的方法。离子注入法的特点是 可以精密地控制扩散法难以得到的低浓度杂质分布。MOS电路制造中，器件隔离工序中防止寄生沟道用的沟道截断，调整阀值电压用的沟道掺杂，CMOS的阱形成及源漏区的形成，要采用离子注入法来掺杂。离子注入法通常是将欲掺入半导体中的杂质在离子源中离子化，然后将通过质量分析磁极后选定了离子进行加速，注入基片中。此时，杂质的注入量可 通过测量流过基片的电流大小来正确控制。离子由基片的表面到停止，形成了近似的高斯分布。设Rp为投影射程， Rp为其的标准偏差，Q为注入量，注入的离子分布C（x）文档来自于网络搜索其中Rp ,

26、A Rp的大小与杂质的种类，加速电压的大小有关以及基片的材料。此 外，有纵向的标准偏差 A Rp，同样也有横向偏差 A Re。离子注入时，通常采用光刻胶 和SiO2作掩模，掩模厚度以不使杂质穿透为原则。离子束的注入角度通常偏离基片法线7oC左右，以防止发生沟道效应（即离子不与原子碰撞而直接进入基片深层）。离子注入后，要在800-1000 oC的高温下进行热处理（即退火处理），以使离子注入时产生的结晶损伤得到恢复，同时为了防止硅表面的污染。通常要在注入区表面形成薄薄的SiO2层，杂质离子透过这层 SiO2进行注入。文档来自于网络搜索硅和锗半导体材料经高度提纯后，其原子排列已变成非常整齐的晶体状态

27、，称为单晶体也称本征半导体。在本征半导体硅或锗中掺入少量五价杂质元素如磷(P)、锑(Sb)、砷(As)等，因为杂质的浓度很小(10 8个硅或锗原子中掺入一个磷原子)，所以杂质被晶格中的主原子所包围。掺入的五价杂质，它的四个价电子与其相邻的四个主原子的价电子形成 共价键，第五个价电子不能形成共价键而变成自由电子。因为它有盈余的自由电子，所以五价杂质称为施主杂质，掺杂为N型半导体。而掺杂三价杂质，则会因缺少一个价电子而形成一个空位，掺杂为P型半导体。文档来自于网络搜索(7) 去除光刻胶，放高温炉中进行退火处理以消除晶圆中晶格缺陷和内应力，以恢复晶格的完整性。使植入的掺杂原子扩散到替代位置， 产生电

28、特性。并使原先的SiO2膜厚度增加，达到阻止下一步中n型杂质注入 P型阱中。文档来自于网络搜索1扩散技术向半导体中掺杂的方法有扩散和离子注入法。扩散法是将掺杂气体导入放有硅片的高温炉，将杂质扩散到硅片内一种方法。优点是批量生产，获得高浓度掺杂。杂质扩散有两道工序：预扩散 (又称预淀积 Predeposition )和主扩散 (drive in )。文档来自于网络搜索 预扩散工序是在硅表面较浅的区域中形成杂质的扩散分布，这种扩散分布中，硅表面杂质浓度的大小是由杂质固溶度来决定的。文档来自于网络搜索主扩散工序是将预扩散时形成的扩散分布进一步向深层推进的热处理工序。杂质的扩散浓度取决于与温度有关的扩

29、散系数D的大小和扩散时间的长短。硅集成电路工艺中，往往采用硼作为P型杂质，磷作为N型杂质。它们固溶度高，均10 20 cm - 3。除此之外，还使用砷和锑等系数小的杂质，这对于不希望产生杂质再分布的场合是有效的。杂质扩散层的基本特性参数是方块电阻RF和结果 Xj。 RF可用四探针测量法。Xj可用倾斜研磨(Angle lapping)和染色(staining)法，(如用 HF ： H3PO4 = 1 : 6 使 P 层黑化), 或扩展电阻(spreadi ng resista nee)法来进行评估。倾斜研磨后，经侵蚀的酸溶液蚀刻，将 guttering后集积在晶片下半部的析出物凸显出来，显现出密

30、度的轨迹，而在靠晶片的表面 附近出现一段空泛区，经过角度换算，约20um。文档来自于网络搜索(8) 用热磷酸去除氮化硅层，掺杂磷 (P+5)离子，形成 N型阱(9) 退火处理，然后用 HF去除SiO2层(10) 干法氧化法生成一层SiO2层，然后 LPCVD沉积一层氮化硅此时P阱的表面因 SiO2层的生长与刻蚀已低于 N阱的表面水平面。这里的 SiO2层和 氮化硅的作用与前面一样。接下来的步骤是为了隔离区和栅极与晶面之间的隔离层。文档来自于网络搜索(11) 利用光刻技术和离子刻蚀技术，保留下栅隔离层上面的氮化硅层(12) 湿法氧化，生长未有氮化硅保护的SiO2层，形成PN之间的隔离区(13)

31、热磷酸去除氮化硅，然后用 HF溶液去除栅隔离层位置的SiO2，并重新生成品质 更好的SiO2薄膜，作为栅极氧化层。文档来自于网络搜索(14) LPCVD 沉积多晶硅层，然后涂敷光阻进行光刻，以及等离子蚀刻技术，栅极结构，并氧化生成 SiO2保护层。文档来自于网络搜索(15) 表面涂敷光阻，去除P阱区的光阻，注入砷 (As)离子，形成NMOS的源漏极。 用同样的方法，在 N阱区，注入 B离子形成PMOS的源漏极。文档来自于网络搜索(16) 利用PECVD 沉积一层无掺杂氧化层，保护元件，并进行退火处理。(17) 沉积掺杂硼磷的氧化层含有硼磷杂质的 SiO2层，有较低的熔点，硼磷氧化层(BPSG)

32、加热到800 oC时会软化并有流动特性，可使晶圆表面初级平坦化。文档来自于网络搜索(18) 濺镀第一层金属利用光刻技术留出金属接触洞，溅镀钛+氮化钛+铝+氮化钛等多层金属膜。离子刻蚀出布线结构，并用PECVD在上面沉积一层 SiO2介电质。并用 SOG (spin on glass)使表面平坦，加热去除SOG中的溶剂。然后再沉积一层介电质，为沉积第二层金属作准备。文档来自于网络搜索1薄膜的沉积方法根据其用途的不同而不同，厚度通常小于1um。有绝缘膜、半导体薄膜、金属薄膜等各种各样的薄膜。薄膜的沉积法主要有利用化学反应的CVD(chemical vapordeposition)法以及物理现象的P

33、VD(physical vapor deposition)法两大类。CVD 法有外延生长法、HCVD ， PECVD等。PVD有溅射法和真空蒸发法。一般而言，PVD温度低，没有毒气问题；CVD温度高，需达到1000 oC以上将气体解离，来产生化学作用。PVD 沉积到材料表面的附着力较CVD差一些，PVD适用于在光电产业，而半导体制程中的金属导电膜大多使用PVD来沉积，而其他绝缘膜则大多数采用要求较严谨的CVD技术。以PVD被覆硬质薄膜具有高强度，耐腐蚀等特点。文档来自于网络搜索2 真空蒸发法(Evaporation Deposition )是采用电阻加热或感应加热或者电子束等加热法 将原料蒸发

34、淀积到基片上的一种常用的成膜方法。蒸发原料的分子(或原子)的平均自由程长(10 -4 Pa以下，达几十米)，所以在真空中几乎不与其他分子碰撞可直接到达基片。到 达基片的原料分子不具有表面移动的能量，立即凝结在基片的表面，所以，在具有台阶的表面上以真空蒸发法淀积薄膜时，一般，表面被覆性(覆盖程度)是不理想的。但若可将 Crambo真空抽至超高真空(10- 8 torr ),并且控制电流，使得欲镀物以一颗一颗原子蒸镀上去即成所谓分子束磊晶生长(MBE : Molecular Beam Epitaxy )。文档来自于网络搜索3溅镀(Sputtering Deposition )所谓溅射是用高速粒子(

35、如氩离子等)撞击固体表面， 将固体表面的原子撞击出来，利用这一现象来形成薄膜的技术即让等离子体中的离子加速， 撞击原料靶材，将撞击出的靶材原子淀积到对面的基片表面形成薄膜。溅射法与真空蒸发法相比有以下的特点：台阶部分的被覆性好，可形成大面积的均质薄膜，形成的薄膜，可获得和化合物靶材同一成分的薄膜，可获得绝缘薄膜和高熔点材料的薄膜，形成的薄膜和下层材料具有良好的密接性能。因而，电极和布线用的铝合金(Al-Si, Al-Si-Cu )等都是利用溅射法形成的。最常用的溅射法在平行平板电极间接上高频(13.56MHz )电源，使氩气(压力为1Pa )离子化，在靶材溅射出来的原子淀积到放到另一侧电极上的

36、基片上。为 提高成膜速度，通常利用磁场来增加离子的密度，这种装置称为磁控溅射装置(mag netronsputter apparatus ),以高电压将通入惰性氩体游离，再藉由阴极电场加速吸引带正电的离子，撞击在阴极处的靶材，将欲镀物打出后沉积在基板上。一般均加磁场方式增加电子的游离路径，可增加气体的解离率，若靶材为金属，则使用DC电场即可，若为非金属则因靶材表面累积正电荷，导致往后的正离子与之相斥而无法继续吸引正离子，所以改为 RF电场(因场的振荡频率变化太快，使正离子跟不上变化，而让RF-in的地方呈现阴极效应)即可解决问题。文档来自于网络搜索(19) 光刻技术定出 VIA孔洞，沉积第二层金属，并刻蚀出连线结构。然后，用PECVD法氧化层和氮化硅保护层。文档来自于网络搜索(20) 光刻和离子刻蚀，定出PAD位置(21) 最后进行退火处理，以保证整个Chip的完整和连线的连接性