Vivado高效设计案例分享

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1、Vivado高效设计案例分享用vivado2013.4进行zynq嵌入式系统的设计 软件平台:vivado 2013.4硬件平台:zybo板卡计算机操作系统平台:win7 64位首先安装vivado 2013.4软件。软件安装完成后,打开软件,构建zynq的嵌入式硬件 平台。操作流程如下:2. 出现如下界面:3. 点击Crea te New Projec t,创建新的工程。出现如下创建工程向导,点击nex t。4. 创建新工程的名称,工程路径。选择create project subdirectory。点击next,进 入下一步。5. 创建一个 RTL 工程,选择 Do not specify

2、 sources at this time。点击 next。6.选择parts,选择zynq芯片包括芯片的封装。zybo选用的是xc7z010clg400T的 芯片。选择好芯片,点击nex t,进入下一步。7.点击finish这样一个RTL new project工程已经建立好了。& RTL工程建立完毕后,出现如下工程界面。在这个工程里面,我们需要创建一个block design,点击 create block design。孔 STi ir3 - JU,3Mi.iS,|!-rip4#1 l,a.irt2J,Pf. - Vkidi JUU - n v Ed I ftifl 和心 峙V acu*

3、.听片 4.-pif S K|4 iriwt iTL q K * V| Ti Ci r.a D1. k Zhtiia 比51-*E-RFIE3ini.-i.*.irl r 帔=u 3li dnsi-uIl rIj e -.anji.I arr | X U l.araa 的则Lu*im- :kjh4 PU|I.Wl nrxa 啦 r U 9 lalaLi HasAcZfZ LT.-p!i!Lr. Il M*. rrul-iCh ks:tji4 l. IwiF : Yih*. -UThE iafKir:Lr .13 i:ilLtf-Lb hx w :A hki : ksw. za| IrBfc-r

4、j-rtH iilraUfrL -jmlLi!l_II:n-ful .b f?.a abSil :.N4dnFr/piifcllurlFa I. tliu lai I. ECz 】j! :gjiA H J, . fc. % Dx. Bi |9.输入设计名称,这里我选择默认的设计名称。点击ok。10.在diagram对话框里面选择 ADD IP。并 ,iq 3卜Tpc+dRarupyp1; Ywdt JJ:匕 V n t t41luj 的叶 _i.LM. 咋“ +.: pEJ F-臂冲片U-英 寸卒髀也审施| h 血化E Er-養、Vardh- r MicroBLEIeDelmRModulm 莹

5、IlB3= MiBrnLpN:cs呻5 mLm c El-Icl mmr EMC m * i z ar d烷 Mn WizardZII运5:-D:fl:ft:M.:一戸的::Ln3f.;tl:r*hv!3s a a,-*-dllmH 一VUTVMiliMLK . 訓 . MiJ.iMLK . MilirLK,円口 nr KiliILK,円口nr HililLK. ni - wililF ni -p-minlr QbLPINITI- 9 MJrmdnrH0jr minr obLp門ITlm E, IrMODdni.M-3 0MililEK c 口 mi ilrlrrclnEMminFMy,Mil

6、ilLK,ra口 m - ip-PE 口raeMLnili 伫U1JLsITlfDcf aiLii pr 油IX1IX1EUIEE. or _ir3g; and drop E5C toflSILClvL12inramn block aur+omar+ion。半口憐辅 rocessingsys-+em70。囲 3 nc KU9U i .rt *i Ms . .?1 FTkri一 Etp X * w- J w-n*-L-IT止-总S-FU 空.tE b- -H- E If: HF- F-rjirnrjr r-ulrF - =./!-1*ha-4r= - -rf :=Lr!/ - Z3M UFi=釜

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11、荷定文彳牛:E /co d e/zy n q/ZVB 0_5yn q_d ef.E: / code/zynq/ZTBO_zyiiq_def. xml17.进入 MIO Configuration,取消 USB0.SD0.I2C0。进入 PS-PL configuration 里面, 取消 FCLK_RESET0_N 和 M_AXI_GP0 interface,进入 Clock configuration,取消 FCLK_CLK0. 点击OK保存修改设置。18.点击Ctrl+S保存block设计。)|L- Jxar-q,*-ilp:tw A-5X-.-力出-MLl 土*1. kJI Efl Iw

12、A-補叶丄”呱W衣v阿疋f丰丫厘卫 oQIH:ZVNCT H-.,.PF ri:u- it1 IT P vlhim kgJl玄电虫一辛小金才略 |帝Sl-7hp%si *lu bai r &na I Luebs iirv:.r b . I -fairTtM Rnnl. tfclnq 4 319 右击你的设计 block。选择 create HDL wrapper。SourcesEl-1 Desi gn Sources (1 jdezign_l (desi gn_l. hd) (1)| i-A田 T亡i ConEtraiiitzIB Simulation Sources (1)20.选择 let vivado manage wrapper and auto-update。21. 选择 generate block design。J IF Integra.tQx Cxsate Block De si gjLa Ojen Block Eesi gn黑袖 Gener ate Block Ilesi gjiJ Simulati oil22点击generate。这样一个zynq的嵌入处理器系统就完成了。

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