数电100道单选题100道填空题共12页

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1、精选优质文档-倾情为你奉上一、选择题1十进制数33的余3码为 。A. B. C. D. 2二进制小数-0.0110的补码表示为 。A0.1010 B1.1001 C1.0110 D1.10103两输入与非门输出为0时，输入应满足 。A两个同时为1 B两个同时为0 C两个互为相反 D两个中至少有一个为04某4变量卡诺图中有9个“0”方格7个“1”方格，则相应的标准与或表达式中共有多少个与项 ？A 9 B7 C16 D不能确定5. 下列逻辑函数中，与相等的是 。 6. 设计一个6进制的同步计数器，需要 个触发器。3 4 5 67. 下列电路中，属于时序逻辑电路的是 。编码器 半加器 寄存器 译码器

2、8. 列电路中，实现逻辑功能的是 。 (D)9. 的输出端可直接相连，实现线与逻辑功能。与非门 一般门 集电极开路门 一般门10以下代码中为无权码的为 。 A. 8421BCD码 B. 5421BCD码 C. 余三码 D. 格雷码11以下代码中为恒权码的为 。A.8421BCD码 B. 5421BCD码 C. 余三码 D. 格雷码12一位十六进制数可以用 位二进制数来表示。A. B. C. D. 1613十进制数25用8421BCD码表示为 。A.10 101 B.0010 0101 C. D.1010114在一个8位的存储单元中，能够存储的最大无符号整数是 。A.（256）10 B.（127

3、）10 C.（FF）16 D.（255）1015与十进制数（53.5）10等值的数或代码为 。A.(0101 0011.0101)8421BCD B.(35.8)16 C.(.1)2 D.(65.4)816矩形脉冲信号的参数有 。A.周期 B.占空比 C.脉宽 D.扫描期17与八进制数(47.3)8等值的数为：A. (.011)2 B.(27.6)16 C.(27.3 )16 D. (.11)218. 常用的BCD码有 。A.奇偶校验码 B.格雷码 C.8421码 D.余三码19与模拟电路相比，数字电路主要的优点有 。A.容易设计 B.通用性强 C.保密性好 D.抗干扰能力强20n个变量的最小

4、项是 。A. n个变量的积项，它包含全部n个变量 B. n个变量的和项，它包含全部n个变量C. 每个变量都以原变量或者反变量的形式出现，且仅出现一次。D. n个变量的和项，它不包含全部变量。21当描述同步时序电路的最简状态表中含有（）个状态时，需要两个触发器。A 3 B 4 C 2 D 522组合逻辑电路的结构特点，表现为（ ）。A有记忆功能 B有反馈回路 C不含记忆元件 D无反馈回路23. 以下表达式中符合逻辑运算法则的是 。 A.CC=C2 B.1+1=10 C.01 D.A+1=124. 逻辑变量的取值和可以表示： 。 A.开关的闭合、断开 B.电位的高、低 C.真与假 D.电流的有、无

5、 25. 当逻辑函数有n个变量时，共有 个变量取值组合？ A. n B. 2n C. n2 D. 2n26. 逻辑函数的表示方法中具有唯一性的是 。A.真值表 B.表达式 C.逻辑图 D.卡诺图27.F=A+BD+CDE+D= 。A. B. C. D.28.逻辑函数F= = 。A.B B.A C. D. 29求一个逻辑函数F的对偶式，可将F中的 。A.”换成“+”，“+”换成“” B.原变量换成反变量，反变量换成原变量C.变量不变D.常数中“0”换成“1”，“1”换成“0”E.常数不变30A+BC= 。A .A+B B.A+C C.（A+B）（A+C） D.B+C31在 输入情况下，“与非”运

6、算的结果是逻辑0。 A全部输入是0 B.任一输入是0 C.仅一输入是0 D.全部输入是132在 种输入情况下，“或非”运算的结果是逻辑0。A全部输入是0 B.全部输入是1 C.任一输入为0，其他输入为1 D.任一输入为133. 三态门输出高阻状态时， 是正确的说法。A.用电压表测量指针不动 B.相当于悬空 C.电压不高不低 D.测量电阻指针不动34. 以下电路中可以实现“线与”功能的有 。A.与非门 B.三态输出门 C.集电极开路门 D.漏极开路门35以下电路中常用于总线应用的有 。A.TSL门 B.OC门 C. 漏极开路门 D.CMOS与非门36逻辑表达式Y=AB可以用 实现。A.正或门 B

7、.正非门 C.正与门 D.负或门37TTL电路在正逻辑系统中，以下各种输入中 相当于输入逻辑“1”。A.悬空 B.通过电阻2.7k接电源C.通过电阻2.7k接地 D.通过电阻510接地38对于TTL与非门闲置输入端的处理，可以 。A.接电源 B.通过电阻3k接电源 C.接地 D.与有用输入端并联39要使TTL与非门工作在转折区，可使输入端对地外接电阻RI 。A.RON B.ROFF C.ROFFRIRON D.ROFF40三极管作为开关使用时，要提高开关速度，可 。A.降低饱和深度 B.增加饱和深度 C.采用有源泄放回路 D.采用抗饱和三极管41CMOS数字集成电路与TTL数字集成电路相比突出

8、的优点是 。A.微功耗 B.高速度 C.高抗干扰能力 D.电源范围宽42与CT4000系列相对应的国际通用标准型号为 。A.CT74S肖特基系列 B. CT74LS低功耗肖特基系列C.CT74L低功耗系列 D. CT74H高速系列43.N个触发器可以构成能寄存 位二进制数码的寄存器。 A.N-1 B.N C.N+1 D.2N44在下列触发器中，有约束条件的是 。 A.主从JK F/F B.主从D F/F C.同步RS F/F D.边沿D F/F45一个触发器可记录一位二进制代码，它有 个稳态。A.0 B.1 C.2 D.3 E.446存储8位二进制信息要 个触发器。A.2 B.3 C.4 D.

9、847对于T触发器，若原态Qn=0，欲使新态Qn+1=1，应使输入T= 。A.0 B.1 C.Q D.48对于T触发器，若原态Qn=1，欲使新态Qn+1=1，应使输入T= 。A.0 B.1 C.Q D.49对于D触发器，欲使Qn+1=Qn，应使输入D= 。A.0 B.1 C.Q D.50对于JK触发器，若J=K，则可完成 触发器的逻辑功能。A.RS B.D C.T D.T51欲使JK触发器按Qn+1=Qn工作，可使JK触发器的输入端 。A.J=K=0 B.J=Q,K= C.J=,K=Q D.J=Q,K=0 E.J=0,K=52欲使JK触发器按Qn+1=n工作，可使JK触发器的输入端 。A.J=

10、K=1 B.J=Q,K= C.J=,K=Q D.J=Q,K=1 E.J=1,K=Q53欲使JK触发器按Qn+1=0工作，可使JK触发器的输入端 。A.J=K=1 B.J=Q,K=Q C.J=Q,K=1 D.J=0,K=1 E.J=K=154欲使JK触发器按Qn+1=1工作，可使JK触发器的输入端 。A.J=K=1 B.J=1,K=0 C.J=K= D.J=K=0 E.J=,K=055欲使D触发器按Qn+1=n工作，应使输入D= 。A.0 B.1 C.Q D.56下列触发器中，克服了空翻现象的有 。A.边沿D触发器 B.主从RS触发器 C.同步RS触发器 D.主从JK触发器57下列触发器中，没有

11、约束条件的是 。A.基本RS触发器 B.主从RS触发器 C.同步RS触发器 D.边沿D触发器58描述触发器的逻辑功能的方法有 。A.状态转换真值表 B.特性方程 C.状态转换图 D.状态转换卡诺图59为实现将JK触发器转换为D触发器，应使 。A.J=D,K= B. K=D,J= C.J=K=D D.J=K=60.边沿式D触发器是一种 稳态电路。A.无 B.单 C.双 D.多61下列表达式中不存在竞争冒险的有 。 A.Y=+AB B.Y=AB+C C.Y=AB+AB D.Y=(A+)A62若在编码器中有50个编码对象，则要求输出二进制代码位数为 位。A.5 B.6 C.10 D.5063.一个1

12、6选一的数据选择器，其地址输入（选择控制输入）端有 个。 A.1 B.2 C.4 D.1664.下列各函数等式中无冒险现象的函数式有 。 A. B. C. D. E.65函数，当变量的取值为 时，将出现冒险现象。 A.B=C=1 B.B=C=0 C.A=1，C=0 D.A=0，B=066四选一数据选择器的数据输出Y与数据输入Xi和地址码Ai之间的逻辑表达式为Y= 。A. B. C. D.67.一个8选一数据选择器的数据输入端有 个。A.1 B.2 C.3 D.4 E.868在下列逻辑电路中，不是组合逻辑电路的有 。A.译码器 B.编码器 C.全加器 D.寄存器69八路数据分配器，其地址输入端有

13、 个。A.1 B.2 C.3 D.4 E.870组合逻辑电路消除竞争冒险的方法有 。A. 修改逻辑设计 B.在输出端接入滤波电容C.后级加缓冲电路 D.屏蔽输入信号的尖峰干扰71101键盘的编码器输出 位二进制代码。A.2 B.6 C.7 D.872用三线-八线译码器74LS138实现原码输出的8路数据分配器，应 。A.=1，=D，=0 B. =1，=D，=DC.=1，=0，=D D. =D，=0，=073以下电路中，加以适当辅助门电路， 适于实现单输出组合逻辑电路。A.二进制译码器 B.数据选择器 C.数值比较器 D.七段显示译码器74用四选一数据选择器实现函数Y=，应使 。A.D0=D2=

14、0，D1=D3=1 B.D0=D2=1，D1=D3=0C.D0=D1=0，D2=D3=1 D.D0=D1=1，D2=D3=075用三线-八线译码器74LS138和辅助门电路实现逻辑函数Y=，应 。A.用与非门，Y= B.用与门，Y=C.用或门，Y= D.用或门，Y=76同步计数器和异步计数器比较，同步计数器的显著优点是 。 A.工作速度高 B.触发器利用率高 C.电路简单 D.不受时钟CP控制。77把一个五进制计数器与一个四进制计数器串联可得到 进制计数器。 A.4 B.5 C.9 D.2078下列逻辑电路中为时序逻辑电路的是 。 A.变量译码器 B.加法器 C.数码寄存器 D.数据选择器79

15、. N个触发器可以构成最大计数长度（进制数）为 的计数器。 A.N B.2N C.N2 D.2N80. N个触发器可以构成能寄存 位二进制数码的寄存器。 A.N-1 B.N C.N+1 D.2N81五个D触发器构成环形计数器，其计数长度为 。A.5 B.10 C.25 D.3282同步时序电路和异步时序电路比较，其差异在于后者 。A.没有触发器 B.没有统一的时钟脉冲控制C.没有稳定状态 D.输出只与内部状态有关83一位8421BCD码计数器至少需要 个触发器。A.3 B.4 C.5 D.1084.欲设计0，1，2，3，4，5，6，7这几个数的计数器，如果设计合理，采用同步二进制计数器，最少应

16、使用 级触发器。A.2 B.3 C.4 D.8858位移位寄存器，串行输入时经 个脉冲后，8位数码全部移入寄存器中。A.1 B.2 C.4 D.886用二进制异步计数器从0做加法，计到十进制数178，则最少需要 个触发器。A.2 B.6 C.7 D.8 E.1087某电视机水平-垂直扫描发生器需要一个分频器将31500HZ的脉冲转换为60HZ的脉冲，欲构成此分频器至少需要 个触发器。A.10 B.60 C.525 D.3150088某移位寄存器的时钟脉冲频率为100KHZ，欲将存放在该寄存器中的数左移8位，完成该操作需要 时间。A.10S B.80S C.100S D.800ms89.若用JK

17、触发器来实现特性方程为，则JK端的方程为 。A.J=AB，K= B.J=AB，K= C.J=，K=AB D.J=，K=AB90要产生10个顺序脉冲，若用四位双向移位寄存器CT74LS194来实现，需要 片。A.3 B.4 C.5 D.1091若要设计一个脉冲序列为的序列脉冲发生器，应选用 个触发器。A.2 B.3 C.4 D.1092PROM和PAL的结构是 。A.PROM的与阵列固定，不可编程 B.PROM与阵列、或阵列均不可编程C.PAL与阵列、或阵列均可编程 D.PAL的与阵列可编程93当用专用输出结构的PAL设计时序逻辑电路时，必须还要具备有 。A.触发器 B.晶体管 C.MOS管 D

18、.电容94当用异步I/O输出结构的PAL设计逻辑电路时，它们相当于 。A. 组合逻辑电路 B.时序逻辑电路 B. C.存储器 D.数模转换器95PLD器件的基本结构组成有 。A. 与阵列 B.或阵列 C.输入缓冲电路 D.输出电路96PLD器件的主要优点有 。A. 便于仿真测试 B.集成密度高 C.可硬件加密 D.可改写97GAL的输出电路是 。A.OLMC B.固定的 C.只可一次编程 D.可重复编程98PLD开发系统需要有 。A.计算机 B.编程器 C.开发软件 D.操作系统99只可进行一次编程的可编程器件有 。A.PAL B.GAL C.PROM D.PLD100可重复进行编程的可编程器

19、件有 。A.PAL B.GAL C.PROM D.ISP-PLD二、填空题1. 十六进制数3A.B对应的八进制数是 。2. 十进制数 7.125对应的二进制数是 。3. 要使异或门输出为0，必须令两个输入 。4. n个变量的全部最小项相“或”为 。5. 逻辑函数F=的对偶函数F=_。6. 一个门电路的输出端所能连接的下一级门电路输入端的个数称为该门电路的 7. 时序逻辑电路中，输出信号仅是当前状态的函数，而与_无关的电路称为Moore（摩尔）型时序电路。8. 一个由n变量构成的最小项有 个相邻最小项9. 一个8路数据选择器有 个输入选择控制端。10. 构造一个同步模8计数器需要 个触发器。11

20、. （48）10 =（_）16 =（_）2 。12. 集成触发器三种结构： 、 的和 。13. 函数 的反函数 = 。14. 时序逻辑电路的功能表示方法有： 、 、和 。15. N级环形计数器的计数长度是 ，N级扭环计数器的计数长度是 。16. 寄存器按照功能不同可分为两类： 寄存器和 寄存器。17. 数字电路按照是否有记忆功能通常可分为两类： 、 。18. 由四位移位寄存器构成的顺序脉冲发生器可产生 个顺序脉冲19. 时序逻辑电路按照其触发器是否有统一的时钟控制分为 时序电路和 时序电路。20. 触发器有 个稳态，存储8位二进制信息要 个触发器.21. 一个基本RS触发器在正常工作时，它的约

21、束条件是+=1，则它不允许输入= 且= 的信号。22. 触发器有两个互补的输出端Q、，定义触发器的1状态为 ，0状态为 ，可见触发器的状态指的是 端的状态.23. 一个基本RS触发器在正常工作时，不允许输入R=S=1的信号，因此它的约束条件是 。24. 在一个CP脉冲作用下，引起触发器两次或多次翻转的现象称为触发器的 ，触发方式为 式或 式的触发器不会出现这种现象.25. 逻辑代数又称为 代数。最基本的逻辑关系有 、 、 三种。常用的几种导出的逻辑运算为 、 、 、 、 。26. 逻辑函数的常用表示方法有 、 、 。27. 逻辑代数中与普通代数相似的定律有 、 、 。摩根定律又称为 。28.

22、逻辑代数的三个重要规则是 、 、 。29. 逻辑函数F=+B+D的反函数= 。30. 逻辑函数F=A（B+C）1的对偶函数是 。31. 添加项公式AB+C+BC=AB+C的对偶式为 。32. 逻辑函数F=+A+B+C+D= 。33. 逻辑函数F= 。34. 已知函数的对偶式为+，则它的原函数为 。35. 同一逻辑函数的两种逻辑表达式中的最大项 Mi 与最小项 mi 之间的关系有 Mi=_ ， Mi+mi=_。36. 多变量异或运算时，若，则 Xi=1 的个数必为 _数。（奇或偶）37. 七段译码器的输入是 _ 码 。38. 在多路复用器中， s 个输入用于选择 N 个数据源，则 s= _39.

23、 带使能输入的 _ 可以用做多路分配器。40. 若 JK 触发器 Q*=Q ，则输入（ J ， K ） = _ 。如果用 D 触发器完成相同功能，则 D= _ 。41. 时序电路又被称作有限状态机，并且可以进一步划分为 _ 机和 _ 机。42. _方程将触发器的下一状态定义为触发器当前状态和输入的函数。 43. 一个具有 n 个触发器的机器中，状态的总数为 _ 。 44. 设计一个模 65 的同步计数器，至少需要 _ 个触发器.45. 产生序列 ，至少需要 _ 个触发器。46. 在状态图中，只要包含有 _ 的时序电路都可称为计数器.47. 一个 _ 触发器就是一个一位的二进制计数器。48. 已

24、知m序列信号发生器的反馈函数f（Q）=Q3 Q4，则其循环长度（序列长度）S= 。49. F（A，B，C，D）=1，其最小项表达式F=m（_）。50. 函数，其反函数=_；对偶式F*=_。51. RAM与ROM的区别是 。52. 动态存储单元为不丢失信息，必须 。53. 将D触发器的D端连在 端上，假设Q（t）=0，则经过100个脉冲作用后，它的次态Q(t+100)为_。54. 已知一个最长线性序列码发生器的反馈函数是F（Q）=Q5Q6，试求：序列码的长度S= ；需用触发器的个数N= 。55. RAM的优点是_，_；缺点是_，它是_存储器。56. 由于R-S触发器有_个稳态，因此它可记录_位二

25、进制码。若存储一字节二进制信息，需要_个触发器。57. 组合电路与时序电路的主要区别： 。58. PAL的与阵列_编程，或阵列_编程。59. 将逻辑函数化成最小项之和的标准形式： (= )。60. 三态门的输出端有三种可能出现的状态： 、 和 。61. 写出触发器的特征方程： 。62. 衡量存储器性能的两个重要指标是 和 。63. 与模拟信号相比，数字信号的特点是它的 性。一个数字信号只有 种取值分别表示为 和 。64. 布尔代数中有三种最基本运算： 、 和 ，在此基础上又派生出四种基本运算，分别为 、 、 和 。65. EPROM是 可编程只读存储器，EEPROM是 可编程只读存储器。66.

26、 FPGA是指 ，它是一种 密度的可编程逻辑器件。67. GAL是指 ，ISP是指 。68. 函数式F=AB+BC+CD 写成最小项之和的形式结果应为m ( ),写成最大项之积的形式结果应为M( )。69. 判断下列逻辑运算说法是否正确。（1） 若X+Y=X+Z，则Y=Z；( )（2） 若XY=XZ，则Y=Z；( )（3） 若X Y=X Z，则Y=Z；( )70. 组合逻辑电路的特点是任意时刻的 状态仅取决于该时刻的 状态，而与信号作用前电路的状态 。71. 组合逻辑电路在结构上不存在输出到输入的 ， 因此 状态不影响 状态。72. 数据分配器的结构与 相反，它是一种 输入， 输出的逻辑电路。

27、从哪一路输出取决于 。73. 一个十六路数据选择器，其地址输入端有 个。74. 设A0、A1 为四选一数据选择器的地址码，X0X3 为数据输入，Y 为数据输出，则输出Y 与数据输入和地址码的关系为 。75.描述触发器的逻辑功能的方法有 ； ； ；76. 将基本RS 触发器的S 和Q、R 和Q端相连成新的触发器，其特征方程是 。77. 若D 触发器的D 端连在Q端上，经100 个脉冲作用后，其次态为0，则现为 。78. SD 和RD 为触发器的异步置1 和置0 端，若触发器异步置0，须使SD= ，RD= ，而与 和 无关。79. 对于JK 触发器，若J=K，则可完成 触发器的逻辑功能；若K =

28、J，则可完成 触发器的逻辑功能。80. 时序逻辑电路一般由 和 两步分组成的。时序逻辑电路的特点是某一时刻的 状态不仅取决于该时刻的 ，而且与信号作用前电路的状态 。81. 时序逻辑电路在结构上存在输出到输入的 ，因此， 状态会影响 状态。82. 时序逻辑电路分为两类： 和 。其中 有一个统一的时钟脉冲源，存储电路里所有 的状态变化，都在同一个时钟脉冲CP作用下同时发生；而 没有统一的时钟脉冲。83. 时序逻辑电路中的存储电路受时钟控制的 组成。84. 同步时序逻辑电路中，所有触发器状态的变化都是在 操作下进行的；异步时序逻辑电路中，各触发器的时钟信号 ，因而触发器状态的变化并不都是 发生的，

29、而是 。85. 全面描述一时序逻辑电路的功能， 必须使用三个方程式。它们是 、 、 .86. 为了把时序电路的逻辑功能直观、形象地显示出来，有时需要把有输出方程、状态方程和控制方程表示的逻辑关系表示成 、 、或 的形式。87. 触发器有 个稳定状态，它可以记录 位二进制码，存储8 位二进制信息需要 个触发器。88. 用来表示时序电路状态转换规律的输入、输出关系的有向图称为 ，计数器中有效状态的数目称为计数器的 。89. 模为2 的正整数次幂的二进制递增计数器，若从其反向输出端Q输出，则得同模 计数器。90. 计数器的功能是 ，它是用电路的 来表示计数值。计数器的模是指 。91. 按计数进位制计

30、数器可分为 和 两类。按进位方式计数器可分为 和 两类。按逻辑功能计数器可分为 、 和 等92. 在各种寄存器中，存放N 位二进制数码需要 个触发器。93. 用反馈移位寄存器产生 序列，至少需要 个触发器。94. n 级反馈移位寄存器的状态数是 。95. 有一个移位寄存器，高位在左，低位在右，欲将存放在该移位寄存器中的二进制数乘上十进制数4，则需将该移位寄存器中的数左移 位，需要 个移位脉冲。96. 逻辑系统包括 、 和 三部分组成。97. 将一个包含有32768 个基本单元的存储电路设计成4096 个字节的RAM，则该RAM 有 根数据线， 根地址线。98. 有一个容量为256 4 位的RAM，该RAM 有 个基本存储单元，该RAM 每次访问 个基本存储单元，该RAM 有 根地址线。99. 将一个包含有16384 个基本单元的存储电路设计设计成8 位为一个字节的ROM，该ROM 有 个地址， 个数据读出线。100.半导体存储器从存取功能上可以分为 存储器和 存储器。存储器容量的扩展方式有 和 两种。专心-专注-专业