最新组合逻辑电路设计实验报告

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1、最新组合逻辑电路设计实验报告 数，被减数，借位加数，被加数，进位Fl (S)F2 (Co)A,B,C分别表示减4.实验步骤1.设计一个舍入与检测逻辑电路:做出真值表：电路框图舍入昌检测迄辑曳值表JLEcDFlF2000G00000L010Q1001001LD0010001010L10011010011L111Q0Q11100L10作出卡诺图，并求出F1,F2Fl(5)的卡楮(3和逻籟熬达式逍精棗达式：F1= aLbcbdF2l怎奇数韵卡褚旳和建轿表达式根据F1F2的表达式做出电路图:4n1613F219/ZZS4EL按照电路图连接号电路，并且验证结果是否与设计相符2,设计一位全加/全减器 做出

2、真值表：F1的卡诺图F1卡诺图:输入2輪岀aS強制W珈C低位进mFl和”F2进借检冲Op0中OpgO+32Op2OpAOpOpOpOp22OpDpDOp2t;12222313l1Op1OpUCTOq2OpIp“23如2Op2Op20中Op220心22Ip1“0卩“2gIpOpg222OpOq22123OpgIp222SA0001 11 100000000101011111L1100101匱軒汞达式：F2= BC-B(S()AC(SA)全加冬减器电路说计按照电路图连接号电路，并且验证结果是否与设计相符5.实验体会 通过这次试验，我理解了用仪器拼接电路的根本情况。懂得 了从电路图到真实电路的根本过程。在连接的时候，很容易因为 线或者门出现问题。第 8 页 共 8 页